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    • 专利摘要:
    本發明涉及一種用於同步化輸入同步信號與輸出同步信號的方法及電路，該方法及電路可根據輸入同步信號的頻率變化來同步化輸出同步信號，並限制輸入週期與輸出週期，從而防止閃爍；一種利用該方法及電路之液晶顯示裝置的背光驅動器以及一種用於驅動該背光驅動器的方法。用於同步化輸入同步信號與輸出同步信號的方法包括：產生輸出同步信號，該輸出同步信號的輸出週期係根據輸入同步信號的輸入週期與該輸出同步信號之先前的輸出週期的比較結果來設置；以及將該輸出同步信號的該輸出週期限制在該先前的輸出週期的預定義的限制範圍內。
    公开号:TW201324489A
    申请号:TW101129222
    申请日:2012-08-13
    公开日:2013-06-16
    发明作者:Yong-Woo Choi
    申请人:Lg Display Co Ltd；
    IPC主号:G09G3-00
    专利说明:
    用於同步化輸入同步信號與輸出同步信號的方法及電路、利用該方法及電路之液晶顯示裝置的背光驅動器以及用於驅動該背光驅動器的方法
    本發明涉及一種用於同步化輸入同步信號與輸出同步信號的方法及電路、一種利用該方法及電路之液晶顯示器裝置的背光驅動器、以及一種用於驅動該驅動背光驅動器的方法。尤其涉及一種用於同步化輸入同步信號與輸出同步信號的方法及電路，該方法及電路可根據輸入同步信號的頻率變化來同步化輸出同步信號，並限制輸入週期與輸出週期，從而防止閃爍。
    使用數位資料顯示影像的平面面板顯示裝置的代表性例子包括：使用液晶的液晶顯示(Liquid Crystal Display，LCD)裝置；使用惰性氣體放電的電漿顯示面板(Plasma Display Panels，PDPs)；使用有機發光二極體的有機發光二極體(Organic Light Emitting Diode，OLED)顯示器裝置。其中，液晶顯示裝置已被廣泛應用到各種領域，例如電視、電腦螢幕、筆記型電腦和手機。
    液晶顯示裝置通過像素矩陣來配置以顯示影像，該像素矩陣使用具有各向異性的液晶的電學和光學特性，例如：折射和介電系數等。液晶顯示裝置的每一個像素藉由在取決於資料信號的液晶的校準方向的變化來調整通過偏振板的光的透光率從而執行灰度(gradation)。該液晶顯示裝置包括：液晶面板，其通過像素矩陣來顯示影像；驅動電路，其驅動液晶面板；背光單元，其反射光給液晶面板；以及背光驅動器，其驅動背光單元。
    目前，因為發光二極體(Light Emitting Diode，LED)比傳統的燈具有更快速的照明操作、高亮度和低功耗的優勢，已使用其光源是發光二極體的LED背光單元。LED背光單元發射使用白色LED或紅綠藍LEDs的結合所產生的白光。此外，LED背光單元不僅可以很好地實現整體調光(global dimming)，該整體調光通過背光單元可控制背光亮度，而且可以實現局部調光(local dimming)，該局部調光以每一位置為基準(例如：每一分塊(split block)的基準)控制背光亮度。
    驅動LED背光單元的背光驅動器用於產生脈寬調變(Pulse Width Modulation，PWM)信號，該脈寬調變信號具有對應於從外部系統(例如：電視或時序控制器)輸入的調光值(dimming value)的負載比(duty ratio)並根據PWM信號調整LED背光單元的開啟/關閉時間以控制LED背光單元的亮度。
    背光驅動器利用分離從外部系統輸入之影像資料的圖框的垂直同步信號(Vertical Synchronization，VSYNC)來同步化LED背光單元與液晶面板。在這種情況下，為了響應輸入垂直同步信號的頻率變化，背光驅動器藉由以每一圖框為基準來計算垂直同步信號的輸入週期以設置輸出週期並產生內部時脈，該內部時脈係使用垂直同步信號的輸出週期來產生PWM信號的負載所需要的。
    然而，關於以每一圖框為基準的垂直同步信號的輸入週期與輸出週期的計算，如果垂直同步信號發生突然的頻率變化，傳統的背光驅動器可能不會根據突然變化的輸入週期來設置輸出週期，從而很難產生內部時脈。這將導致PWM信號的負載比偏離期望值。因而，LED背光單元呈現亮度波動，從而遭受影像品質惡化，例如：螢幕閃爍的發生。
    因此，本發明旨在提供一種用於同步化輸入同步信號與輸出同步信號的方法及電路、一種使用該方法及電路之液晶顯示器裝置的背光驅動器及一種用於驅動該背光驅動器的方法，該背光驅動器顯著地避免由於相關技術的侷限性和不足帶來的一個或更多問題。
    本發明一方面是提供一種用於同步化輸入同步信號與輸出同步信號的方法及電路，該方法及電路可根據輸出同步信號，甚至在同步輸入同步信號與輸出同步信號的操作期間根據輸入同步信號的頻率變化來產生穩定的內部時脈；一種利用該方法及電路之液晶顯示裝置的背光驅動器、以及一種用於驅動該背光驅動器的方法。
    本發明的另一方面是提供一種用於同步化輸入同步信號與輸出同步信號的方法及電路，該方法及電路可防止一輸出同步信號由於一輸入同步信號的頻率變化而突然地變化，從而阻止閃爍；一種利用該方法及電路之液晶顯示裝置的背光驅動器、以及一種用於驅動該背光驅動器的方法。
    本發明更多的優勢、目的和特徵將在下面的描述中部分提出，部分提出的優勢、目的和特徵將根據對下文的研究而對於熟知本領域的技術人員是顯而易見的或可從本發明的實施例中瞭解到。本發明的目的和其他優勢通過說明書，申請專利範圍及所附圖式中指出的特別結構實現並獲得。
    根據此處具體而廣泛描述的本發明的目的，為了獲得這些目的和其他優勢，一種用於同步化輸入同步信號與輸出同步信號的方法包括：產生一輸出同步信號，該輸出同步信號的一輸出週期係根據一輸入同步信號的一輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置；以及將該輸出同步信號的該輸出週期限制在該先前的輸出週期的一預定義的限制範圍內。
    限制該輸出同步信號的該輸出週期可包括：將該輸出週期與該限制範圍作比較；如果該輸出週期在該限制範圍內，保持並輸出該輸出週期；以及如果該輸出週期超出了該限制範圍，將該輸出週期設置為該限制範圍內的一最小值或一最大值以輸出該設置的輸出週期。
    該輸出週期的該限制範圍可預設為“該先前的輸出週期+/-臨界值”，該臨界值可設置小於該先前的輸出週期。
    如果該輸出週期小於該限制範圍，該輸出週期可設置為該限制範圍的該最小值並且可輸出該最小值的該輸出週期；以及如果該輸出週期大於該限制範圍，該輸出週期可設置為該限制範圍的該最大值並且可輸出該最大值的該輸出週期。
    產生該輸出同步信號可包括：檢測該輸入同步信號的一第N輸入週期，其中N為一正整數；判斷該檢測的第N輸入週期是否等於該輸出同步信號之一先前的第N-1輸入週期；如果該檢測的第N輸入週期不等於該輸出同步信號之該先前的第N-1輸入週期，檢測該第N-1輸出週期的結束時間和該第N輸入週期的結束時間之間的差異；在該檢測的差異和該第N輸入週期之間執行計算，並將該計算值設置至一第N輸出週期；以及產生並輸出一具有該設置的第N輸出週期的輸出同步信號。
    檢測該第N輸入週期之後，該方法可進一步包括：判斷該檢測的第N輸入週期是否在一預設的參考範圍內；以及如果該第N輸入週期超出了該參考範圍，產生並輸出一具有該第N-1輸出週期的輸出同步信號，其中如果該第N輸入週期在該參考範圍內，該方法繼續判斷該第N輸入週期是否等於該第(N-1)輸出週期。
    如果該第N輸入週期等於該第N-1輸出週期，該方法進一步包括：將該第N輸入週期設置為該第N輸出週期並輸出該第N輸出週期。設置該計算值至該第N輸出週期可包括：如果該第N輸入週期變得比該第N-1輸出週期大，設置藉由將該檢測的差異加至該第N輸入週期而獲得的一值至該第N輸出週期；以及如果該第N輸入週期變得比該第N-1輸出週期小，設置藉由從該第N輸入週期減去該檢測的差異而獲得的一值至該第N輸出週期。
    該同步信號的該第N輸入週期和該第N輸出週期可具有至少一個週期的時間差。
    該輸入同步信號的該輸入週期為一濾波輸入週期，該濾波輸入週期藉由對複數個相鄰的輸入週期低通濾波來獲得。
    根據本發明的另一方面，一種用於同步化輸入同步信號與輸出同步信號的方法包括：低通濾波一輸入同步信號的複數個相鄰的輸入週期以輸出一濾波輸入週期；以及產生一輸出同步信號，該輸出同步信號的一輸出週期係根據該濾波輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置。
    該濾波輸入週期可藉由分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果來獲得。
    根據本發明的另一方面，一種用於同步化輸入同步信號與輸出同步信號的電路包括：一內部同步信號產生單元，其產生一輸出同步信號，該輸出同步信號的一輸出週期係根據一輸入同步信號的一輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置；以及一週期限制器，其將該輸出同步信號的該輸出週期限制在該先前的輸出週期的一預定義的限制範圍內。
    該週期限制器：將該輸出週期與該限制範圍作比較；如果該輸出週期在該限制範圍內，保持並輸出該輸出週期；以及如果該輸出週期超出了該限制範圍，將該輸出週期設置為該限制範圍內的一最小值或一最大值以輸出該設置的輸出週期。
    該內部同步信號產生單元：檢測該輸入同步信號的一第N輸入週期，其中N為一正整數；判斷該檢測的第N輸入週期是否等於該輸出同步信號之一先前的第N-1輸入週期；如果該檢測的第N輸入週期不等於該輸出同步信號之該先前的第N-1輸入週期，檢測該第N-1輸出週期的結束時間和該第N輸入週期的結束時間之間的差異；在該檢測的差異和該第N輸入週期之間執行計算，並將該計算值設置至一第N輸出週期；以及產生並輸出一具有該設置的第N輸出週期的輸出同步信號。
    該內部同步信號產生單元在該第N輸入週期的該檢測後，判斷該檢測的第N輸入週期是否在一預設的參考範圍內；以及如果該第N輸入週期超出了該參考範圍，該內部同步信號產生單元產生並輸出具有該第N-1輸出週期的該輸出同步信號，以及如果該第N輸入週期在該參考範圍內，該內部同步信號產生單元該方法繼續判斷該第N輸入週期是否等於該第N-1輸出週期。
    如果該第N輸入週期等於該第N-1輸出週期，該內部同步信號產生單元將該第N輸入週期設置為該第N輸出週期以輸出該第N輸出週期，如果該第N輸入週期變得比該第(N-1)輸出週期大，該內部同步信號產生單元設置藉由將該檢測的差異加至該第N輸入週期而獲得的一值至該第N輸出週期；以及如果該第N輸入週期變得比該第N-1輸出週期小，該內部同步信號產生單元設置藉由從該第N輸入週期減去該檢測的差異而獲得的一值至該第N輸出週期。
    用於同步化輸入同步信號與輸出同步信號的電路進一步包括：一低通濾波器，其提供該輸入週期至該內部同步信號產生單元，該輸入週期係藉由對該輸入同步信號的複數個相鄰的輸入週期低通濾波而獲得的一濾波輸入週期。
    根據本發明的另一方面，一種用於同步化輸入同步信號與輸出同步信號的電路包括：一低通濾波器，其執行複數個相鄰的輸入週期的一輸入同步信號的低通濾波以輸出一濾波輸入週期；以及一內部同步信號產生單元，其產生一輸出同步信號，該輸出同步信號的一輸出週期係根據一輸入同步信號的一輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置
    該低通濾波器是一有限脈衝響應濾波器，該有限脈衝響應濾波器分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果。
    根據本發明的另一方面，一種用於驅動液晶顯示裝置的背光驅動器的方法包括：產生並輸出一輸出垂直同步信號，該輸出垂直同步信號使用同步化輸入同步信號與輸出同步信號的方法根據一輸入垂直同步信號的一輸入週期的變化來同步化；根據該輸出垂直同步信號的一輸出週期，產生內部時脈；以及使用該等內部時脈產生一具有一預定的負載比的脈寬調變信號以驅動一背光單元。
    根據本發明的進一步方面，一種液晶顯示裝置的背光驅動器包括：一同步電路，其產生並輸出一輸出垂直同步信號，該輸出垂直同步信號使用同步化輸入同步信號與輸出同步信號的電路根據一輸入垂直同步信號的一輸入週期的變化來同步化；一時脈產生單元，其根據該輸出垂直同步信號的一輸出週期，產生內部時脈；以及一脈寬調變信號產生單元，其使用該等內部時脈產生一具有一預定的負載比的脈寬調變信號以驅動一背光單元。
    本發明前述的一般描述和下文的詳細描述是示範性和解釋性的，並且目的在於提供本發明如申請專利範圍的進一步解釋。
    第1圖是圖解說明根據本發明實施例之液晶顯示裝置的方塊圖。
    在第1圖中所示的液晶顯示裝置包括：液晶面板28；背光單元50；面板驅動單元22，其包括資料驅動器24和閘極驅動器26，用於驅動液晶面板28；背光驅動器30，用於驅動背光單元50；以及時序控制器20，用於控制面板驅動單元22和背光驅動器30的驅動。
    為了提高影像品質並降低功耗，時序控制器20用於使用各種資料處理方法更正從外部輸入的資料，並輸出更正後的資料到面板驅動單元22的資料驅動器24。例如，假設使用LED的背光單元50通過局部調光(local dimming)方法來驅動，那麼時序控制器20通過資料分析判定局部調光值，並藉由通過局部調光減少亮度以補償資料來輸出補償資料，該局部調光值係以每一塊(block)為基準而控制背光單元50的亮度所必需的。為了提高液晶顯示的反應速度，時序控制器20可根據相鄰圖框之間的資料差使用從查詢表中選擇的超越值(overshoot value)或不足值(undershoot value)更正輸入資料為過驅動資料(overdriving data)以輸出更正後的資料。此外，時序控制器20使用從外部輸入的複數個同步信號(例如：垂直同步信號和水平同步信號；資料致能信號；以及點時脈)產生資料控制信號以控制資料驅動器24的驅動時序，並產生控制信號以控制閘極驅動器26的驅動時序。時序控制器20分別輸出產生的資料控制信號和閘極控制信號給資料驅動器24和閘極驅動器26。資料控制信號包括：源極啟動脈衝和源極採樣時脈，用於控制資料信號的鎖存；極性控制信號，用於控制資料信號的極性；以及源極輸出致能信號，用於控制資料信號的輸出時段。閘極控制信號包括：閘極啟動脈衝和閘極位移時脈，用於控制閘極信號的掃描；以及閘極輸出致能信號，用於控制閘極信號的輸出時段。
    面板驅動單元22包括：資料驅動器24，用於驅動液晶面板28的複數個資料線DL；以及閘極驅動器26，用於驅動液晶面板28的複數個閘極線GL。
    資料驅動器24提供來自時序控制器20的影像資料給液晶面板28的複數個資料線DL，以響應來自時序控制器20的資料控制信號。資料驅動器24使用伽瑪(gamma)電壓將來自時序控制器20的數位資料轉換為正極性或負極性類比資料信號，並且每當每個閘極線被驅動時，資料驅動器24提供資料信號給資料線DL。資料驅動器24採取至少一個資料積體電路(Integrated Circuit，IC)的形式。因此，資料驅動器24可安裝在電路薄膜上，例如：帶載封裝(Tape Carrier Package，TCP)薄膜；薄膜覆晶(Chip On Film，COF)薄膜；和撓性印刷電路(Flexible Printed Circuit，FPC)薄膜。資料驅動器24可使用捲帶式自動接合(Tape Automatic Bonding，TAB)的方法連接到液晶面板28，或使用玻璃基板接合(Chip On Glass，COG)方法安裝在液晶面板28上。
    閘極驅動器26依序地驅動複數個形成在液晶面板28的薄膜電晶體陣列上的閘極線GL，以響應來自時序控制器20的閘極控制信號。閘極驅動器26在每個閘極線GL之每個對應的掃描時段提供掃描脈衝的閘極啟動電壓，在其他閘極線GL驅動的持續週期內提供閘極關閉電壓。閘極驅動器26採取至少一個閘極IC的形式。因此，閘極驅動器26可安裝在電路薄膜上，例如：帶載封裝薄膜；薄膜覆晶薄膜；和撓性印刷電路薄膜，並且使用捲帶式自動接合的方法連接到液晶面板28，或使用玻璃基板接合方法安裝在液晶面板28上。此外，閘極驅動器26使用閘極面板(Gate In Panel，GIP)方法嵌入在液晶面板28，並可與像素陣列一起形成在薄膜電晶體基板上。
    液晶顯示面板28包括：彩色濾光基板，在該彩色濾光基板上形成彩色濾光陣列；薄膜電晶體基板，在該薄膜電晶體基板上形成薄膜電晶體陣列；液晶層，該液晶層在彩色濾光基板和薄膜電晶體基板之間；以及偏振板，該偏振板分別連接到彩色濾光基板和薄膜電晶體基板的外表面。液晶面板28通過複數個像素的矩陣顯示影像。每一個像素通過紅色、綠色和藍色子像素的組合產生所需的顏色，該子像素藉由改變根據資料信號的液晶的校準來調整透光率。每一個子像素包括：薄膜電晶體(Thin Film Transistor，TFT)，該薄膜電晶體連接到對應的閘極線GL和資料線DL；液晶電容Clc及儲存電容Cst，該等電容係並聯至薄膜電晶體TFT。液晶電容Clc利用通過薄膜電晶體TFT提供至像素電極的資料信號和提供至公共電極的公共電壓Vcom之間的電壓差來充電，並使用該充電的電壓驅動液晶來調整透光率。儲存電容Cst輔助以平穩保持充電至液晶電容Clc的電壓。液晶層可通過垂直電場(例如：扭曲向列(Twisted Nematic，TN)模式；或垂直對齊(Vertical Alignment，VA)模式)來驅動或通過水平電場(例如：面板內轉換(In-Plane Switching，IPS)模式；或邊緣電場轉換(Fringe Field Switching，FFS)模式)來驅動。
    背光單元50包括垂直型(vertical type)或邊緣型(edge type)LED背光，該LED背光由背光驅動器30分裂驅動(split-driven)成複數個塊以照射光到液晶面板28上。在垂直型LED背光的情況下，LED陣列設置在整個顯示區域上以面對液晶面板28。在邊緣型LED背光的情況下，LED陣列設置以面對面對液晶面板28的光導向面板的至少兩邊緣，這樣來自LED陣列的照射光通過光導向面板轉換成平面光藉以直接照到液晶面板28.
    背光驅動器30根據來自外部系統或時序控制器20的調光值以每一LED塊為基準來驅動LED背光單元50，從而以每一LED塊為基準控制亮度。假設背光單元50被分裂驅動為複數個埠區域(port area)，可提供複數個背光驅動器30以獨立驅動複數個埠區域。背光驅動器30以每一塊為基準藉由產生具有對應於調光值的負載比的脈寬調變信號來驅動背光單元50，並以每一LED塊為基準提供對應於該產生的PWM信號的LED驅動信號。在這種情況下，為了同步化LED背光單元50與液晶面板28，背光驅動器30使用垂直同步信號(以下簡稱“VSYNC”)產生PWM信號，該垂直同步信號為自外部系統或時序控制器20輸入的圖框分信號(frame dividing signal)。
    尤其，為了適當地響應輸入VSYNC的頻率變化，背光驅動器30產生並輸出內部VSYNC，該內部VSYNC的輸出週期根據輸入VSYNC的輸入週期與該內部VSYNC之先前的輸出週期的比較結果來設置，該輸入VSYNC的輸入週期係以每一圖框為基準(每一週期為基準)。一種用於同步化輸入VSYNC和輸出VSYNC的方法由本發明申請人在韓國專利申請第10-2010-0140615號(於2010年12月31號提交)中詳細揭露。
    在先前專利申請中揭露的同步方法中，為了互相同步化輸入VSYNC和輸出VSYNC，背光驅動器30以每一圖框為基準(每一週期為基準)檢測輸入VSYNC的輸入週期，並將檢測的輸入週期與內部VSYNC之先前的輸出週期作比較。如果輸入VSYNC的輸入週期等於內部VSYNC之先前的輸出週期，背光驅動器30產生並輸出內部VSYNC，該內部VSYNC的輸出週期等於輸入週期(即先前的輸出週期)。另一方面，如果輸入VSYNC的輸入週期不等於內部VSYNC之先前的輸出週期，背光驅動器30檢測輸入週期的結束時間和先前的輸出週期(即先前的輸出週期將結束的時間)的結束時間之間的差值，並通過該差值調整輸入週期。背光驅動器30設置該調整的輸入週期為輸出週期，從而產生並輸出具有該設置的輸出週期的內部VSYNC。
    此外，為了阻止輸出週期由於輸入VSYNC的輸入週期的突然變化而突然變化，背光驅動器30進一步限制輸入週期和/或輸出週期。作為用於限制內部VSYNC的週期的方法，背光驅動器30採用一種用於自先前的輸出週期在預定義的範圍內限制當前的輸出週期的方法和/或一種通過有限脈衝響應(Finite Impulse Response，FIR)濾波器限制輸入週期的方法，在該有限脈衝響應(FIR)濾波器中，比重被施加到複數個相鄰的輸入週期以將結果反映至當前的輸入週期。在該些方法中，背光驅動器30可產生穩定的內部VSYNC，該內部VSYNC的輸出週期具有限制的變化寬度，即使輸入VSYNC的頻率(週期)突然地改變。
    接著，背光驅動器30產生內部時脈，該等內部時脈係根據內部(輸出)VSYNC的輸出週期產生PWM信號的負載比所必須的。背光驅動器30產生PWM信號，該PWM信號的負載比係被預設的或藉由計算該等產生的內部時脈根據外部亮度的調整來調整，從而使用PWM信號驅動背光單元50。PWM信號與內部VSYNC的輸出週期具有同樣的週期。
    如上所述，藉由根據輸入VSYNC的輸入週期和內部VSYNC之先前的輸出週期之間的比較結果來設置內部VSYNC的輸出週期並限制輸入輸出週期在預定義的範圍內，即使輸入週期突然或重複地變化，在阻止輸出週期突然變化的同時，背光驅動器30可實現輸入輸出週期的同步，甚至在同步時也可產生並輸出穩定的輸出同步信號。結果，背光驅動器30可阻止內部時脈的遺漏和由於輸入VSYNC的頻率變化引起的同步破損，可穩定產生具有期望負載比的PWM信號，也可阻止閃爍。
    同時，為了獲得比較輸入VSYNC的輸入週期和內部VSYNC之先前的輸出週期所需要的計算時間，根據比較結果調整輸入週期並利用調整後的輸入週期作為輸出週期，背光單元30產生並輸出內部VSYNC以確保內部VSYNC具有與輸入VSYNC至少大約一圖框(一個週期)的延遲時間。
    此外，背光單元30在互相同步化輸入VSYNC與輸出VSYNC之前，即在比較輸入VSYNC的輸入週期和內部VSYNC之先前的輸出週期之前，可額外地執行比較該檢測的輸入週期與參考範圍的操作，然後再選擇性地根據該比較結果執行互相同步化輸入VSYNC和內部VSYNC的操作，該參考範圍包括預設的最小限制值MIN和預設的最大限制值MAX。
    例如，如果檢測的輸入VSYNC的輸入週期在參考範圍內，背光驅動器30比較輸入VSYNC的輸入週期與內部VSYNC之先前的輸出週期，並根據該比較結果居先繼行輸入VSYNC與內部VSYNC的同步。另一方面，如果輸入VSYNC的檢測輸入週期偏離了參考範圍，背光驅動器30產生並輸出內部VSYNC，該內部VSYNC持續保持在沒有輸入VSYNC和內部VSYNC的同步的先前的輸出週期。VSYNC週期的參考範圍由設計者預先設置並儲存在背光驅動器30的內部暫存器中。
    在這種方式下，即使輸入VSYNC偏離了參考範圍和由於外部噪音而不穩定等，背光驅動器30可產生並輸出穩定的內部VSYNC。
    第2圖為說明根據本發明第一實施例之背光驅動器的內部配置的方塊圖，第3圖為說明用於同步化在第2圖中所示之背光驅動器的輸入VSYNC和輸出VSYNC的方法的序列的流程圖。
    在第2圖中所示的背光驅動器30包括內部VSYNC產生單元52、週期限制器54、內部時脈(以下，簡稱PCLK)產生單元56、以及PWM產生單元58，以上都彼此相連。
    在步驟S100，內部VSYNC產生單元52以每一週期為基準檢測輸入VSYNC I_VSYNC的輸入週期，比較該檢測的輸入週期與先前的輸出週期，並產生以及輸出內部VSYNC O_VSYNC_A，該內部VSYNC O_VSYNC_A的輸出週期根據比較結果來設置。
    尤其是，內部VSYNC產生單元52檢測從外部系統或從時序控制器20輸入的輸入VSYNC I_VSYNC的輸入週期，並判斷該檢測的輸入週期是否在預定週期參考範圍MIN~MAX內。如果輸入週期偏離了參考範圍MIN~MAX，內部VSYNC產生單元52產生並輸出內部VSYNC O_VSYNC_A，該內部VSYNC O_VSYNC_A保持先前的輸出週期。如果輸入週期在參考範圍MIN~MAX內，內部VSYNC產生單元52判斷輸入週期是否等於先前的輸出週期。如果輸入VSYNC I_VSYNC等於內部VSYNC O_VSYNC_A之先前的輸出週期，內部VSYNC產生單元52設置輸入VSYNC I_VSYNC的輸入週期為輸出週期，並產生且輸出具有設置的輸出週期的內部VSYNC O_VSYNC_A。另一方面，如果輸入VSYNC I_VSYNC的輸入週期不等於內部VSYNC O_VSYNC_A之先前的輸出週期，內部VSYNC產生單元52檢測輸入週期的結束時間和先前的輸出週期(即，先前的輸出週期將要結束的時間)的結束時間之間的差值，設置藉由計算(增加或減少)該檢測的差值和輸入週期而獲得的一值至輸出週期，並產生且輸出具有設置的輸出週期的內部VSYNC O_VSYNC_A。
    在步驟S200至S204，週期限制器54將自內部VSYNC產生單元52所提供的內部VSYNC O_VSYNC_A的輸出週期限制在先前的輸出週期預定義範圍內，以輸出該限制的輸出週期。
    更詳細地，在步驟S200，週期限制器54將內部VSYNC O_VSYNC_A之當前的輸出週期O_VSYNC[n]與從先前的輸出週期O_VSYNC[n-1]到預定義限制區間O_VSYNC[n-1]+/- LMT作比較，其中LMT為臨界值。在步驟S202，如果當前的輸出週期O_VSYNC[n]被判定在限制區間O_VSYNC[n-1]+/- LMT內，週期限制器54產生並輸出具有當前的輸出週期O_VSYNC[n]的內部VSYNC O_VSYNC_B。另一方面，如果內部VSYNC O_VSYNC之當前的輸出週期O_VSYNC[n]被判定偏離了限制區間O_VSYNC[n-1]+/-LMT，週期限制器54設置限制區間O_VSYNC[n-1]+/-LMT(即，先前的輸出週期O_VSYNC[n-1]+/-臨界值LMT”)至輸出週期，並產生且輸出具有設置的輸出週期的內部VSYNC O_VSYNC_B。如果當前的輸出週期O_VSYNC[n]小於限定區間O_VSYNC[n-1]+/-LMT，輸出週期設置為“先前的輸出週期O_VSYNC[n-1]減去臨界值LMT”。另一方面，如果當前的輸出週期O_VSYNC[n]大於限制區間O_VSYNC[n-1]+/-LMT，輸出週期設置為“先前的輸出週期O_VSYNC[n-1]加上臨界值LMT”。在此，限制內部VSYNC O_VSYNC的輸出週期的臨界值LMT係由設計者預設為先前之輸出週期範圍內的適當值並儲存在內部暫存器中。例如，限制內部VSYNC O_VSYNC的輸出週期的臨界值LMT可設在當前的輸出週期的+/-10%範圍內。週期限制器54輸出內部VSYNC O_VSYNC_B給PCLK產生單元56。此外，如果複數個背光驅動器被串級連接，週期限制器54可輸出內部VSYNC O_VSYNC_B給下階段的背光驅動器。
    PCLK產生單元56根據自週期限制器54提供的內部VSYNC O_VSYNC_B的輸出週期，產生並輸出內部時脈PCLK。
    PWM產生單元58使用自PCLK產生單元56提供的內部時脈PCLK產生PWM信號，並輸出PWM信號給背光單元50，該PWM信號具有根據從外部系統或時序控制器輸入的調光值的負載比。
    第4圖是詳細說明在第3圖中所描述之內部VSYNC產生操作S100的流程圖。
    在操作步驟S2中，內部VSYNC產生單元52檢測輸入VSYNC I_VSYNC之當前的第N週期，其中N為一正整數。內部VSYNC I_VSYNC的輸入週期藉由計算背光驅動器30所產生的系統時脈SCLK來檢測。內部VSYNC產生單元52將檢測的第N輸入週期儲存在內部暫存器中。內部VSYNC產生單元52以每一週期為基準檢測輸入週期以更新儲存在內部暫存器裏的輸入週期。
    在操作步驟S4中，內部VSYNC產生單元52比較在操作步驟S2中所檢測的輸入VSYNC I_VSYNC的第N輸入週期與預設的週期參考範圍MIN~MAX，並判斷第N輸入週期是否在週期參考區間MIN~MAX內。有關輸入VSYNC I_VSYNC的週期參考區間MIN~MAX係由設計者設置以阻止噪音等，並儲存在背光驅動器30的內部暫存器裏。
    在操作步驟S4中，如果判斷輸入VSYNC I_VSYNC的第N輸入週期偏離了週期參考區間MIN~MAX(第4圖中的否)，內部VSYNC產生單元52繼續進行操作步驟S6。在操作步驟S6中，內部VSYNC產生單元52產生並輸出內部VSYNC O_VSYNC_A，該內部VSYNC O_VSYNC_A的輸出週期等於內部暫存器儲存之先前的第N-1輸出週期。換句話說，如果輸入VSYNC I_VSYNC的第N輸入週期小於參考區間MIN~MAX的下限值或大於參考區間MIN~MAX的上限值，內部VSYNC產生單元52設置先前的第N-1輸出週期為第N輸出週期，從而穩定產生並輸出第N內部VSYNC O_VSYNC_A。因此，即使由於外部噪音等，輸入VSYNC I_VSYNC不穩定，內部VSYNC產生單元52可產生並輸出穩定的內部VSYNC O_VSYNC。內部VSYNC產生單元52儲存該產生的內部VSYNC O_VSYNC_A的第N輸出週期並在下一階段利用它作為先前的週期值。
    另一方面，在操作步驟S4中，如果判斷輸入VSYNC I_VSYNC的第N輸入週期在參考區間MIN~MAX內(第4圖中的是)，內部VSYNC產生單元52繼續進行操作步驟S8。在操作步驟S8中，內部VSYNC產生單元52比較儲存在內部暫存器裏的輸入VSYNC I_VSYNC的第N輸入週期與內部VSYNC O_VSYNC_A的第N-1輸出週期，並判斷第N輸入週期是否等於第N-1輸出週期。
    在操作步驟S8中，如果判斷輸入VSYNC I_VSYNC的第N輸入週期等於內部VSYNC O_VSYNC_A的第N-1輸出週期(第4圖中的是)，內部VSYNC產生單元52繼續進行操作步驟S10。在操作步驟S10中，內部VSYNC產生單元52設置第N輸入週期為第N輸出週期並在內部暫存器裏儲存設置的第N輸出週期。從而內部VSYNC產生單元52產生並輸出具有儲存輸出週期的第N內部VSYNC O_VSYNC_A。
    另一方面，在操作步驟S8中，如果判斷輸入VSYNC I_VSYNC的第N輸入週期不等於內部VSYNC O_VSYNC_A的第N-1輸出週期(第4圖中的否)，內部VSYNC產生單元52繼續進行操作步驟S12。在操作步驟S12中，內部VSYNC產生單元52判斷內部VSYNC O_VSYNC的第N-1輸出週期是否在輸入VSYNC I_VSYNC的第N輸入週期結束之前結束。換句話說，內部VSYNC產生單元52判斷輸入VSYNC I_VSYNC的第N輸入週期是否大於第N-1輸出週期，即輸入VSYNC I-VSYNC的頻率是否增加。
    在操作步驟S12中，如果判斷內部VSYNC O_VSYNC的第N-1輸出週期在輸入VSYNC I_VSYNC的第N輸入週期被計算(結束)(第4圖中的是)之前結束，換句話說，如果第N輸入週期變得大於第N-1輸出週期(即，輸入VSYNC I_VSYNC的頻率增加)，內部VSYNC產生單元52繼續進行操作步驟S14。在操作步驟S14中，內部VSYNC產生單元52檢測內部VSYNC O_VSYNC_A的第N-1輸出週期將結束的時間和輸入VSYNC I_VSYNC的第N輸入週期的結束時間之間的差值。在此，從儲存在暫存器裏的第N-1輸出週期可預見內部VSYNC O_VSYNC_A的第N-1輸出週期將結束的時間。
    在操作步驟S16中，內部VSYNC產生單元52將在操作步驟S14中檢測的內部VSYNC O_VSYNC_A的第N-1輸出週期將結束的時間和輸入VSYNC I_VSYNC的第N輸入週期的結束時間之間的差值加至第N輸入週期，並將總和設置至第N輸出週期。然後，內部VSYNC產生單元52繼續進行操作步驟S10，從而產生並輸出設置在操作步驟S16中具有第N輸出週期的內部VSYNC O_VSYNC_A。
    在操作步驟S12中，如果判斷內部VSYNC O_VSYNC_A之先前的第N-1輸出週期沒在輸入VSYNC I_VSYNC的第N輸入週期被計算(結束)(圖4中的否)之前結束，換句話說，如果第N輸入週期變得小於第N-1輸出週期(即，輸入VSYNC I_VSYNC的頻率減小)，內部VSYNC產生單元52繼續進行操作步驟S18。在操作步驟S18中，內部VSYNC產生單元52檢測內部VSYNC O_VSYNC_A的第N-1輸出週期的結束時間和輸入VSYNC I_VSYNC的第N輸入週期的結束時間之間的差值。
    在操作步驟S20中，內部VSYNC產生單元52從第N輸入週期減去在操作步驟S18中所檢測之內部VSYNC O_VSYNC_A的第N-1輸出週期的結束時間和輸入VSYNC I_VSYNC的第N輸入週期的結束時間之間的差值，並設置該結果為第N輸出週期。然後，內部VSYNC產生單元52繼續進行操作步驟S10，從而產生並輸出設置在操作步驟S20中具有第N輸出週期的內部VSYNC O_VSYNC_A。
    第5圖為說明在第2圖所示之背光驅動器中輸入VSYNC的頻率變快的情況下，輸入VSYNC和輸出VSYNC的同步以及輸出週期變化的波形圖。第6圖為說明在第2圖所示之背光驅動器中輸入VSYNC的頻率變慢的情況下，輸入VSYNC和輸出VSYNC的同步以及輸出週期變化的波形圖。
    參考第5圖和第6圖，可察知當輸入VSYNC變快或慢時，儘管產生在內部VSYNC產生單元52的內部VSYNC O_VSYNC_A迅速跟隨輸入VSYNC從而與輸入VSYNC同步化，因為週期變化寬度比較大，因而存在閃爍的危險。另一方面，也可察知，根據先前的輸出週期，週期限制器54限制輸出週期在預定義的區間內，儘管內部VSYNC O_VSYNC_B和輸入VSYNC的同步執行地較慢，週期變化寬度比較小，這可防止由於週期的突然變化引起的閃爍。
    第7圖為說明根據本發明第二實施例之背光驅動器的內部配置的方塊圖，第8圖為說明在第7圖中所示之FIR濾波器51的較佳配置的方塊圖。
    在第7圖中所示的背光驅動器與第2圖中所示的背光驅動器大致相同，除了在VSYNC產生單元52的輸入末端提供FIR濾波器51來代替週期限制器54外，因此，與第2圖重複配置的詳細描述將予以省略。
    FIR濾波器51是低通濾波器。該FIR濾波器51藉由施加比重(weights)到輸入I_VSYNC之當前的輸入週期和複數個相鄰的先前的輸入週期輸出關於複數個輸入週期的平均值來將結果反映至當前的輸入週期，從而減少輸入週期的變化寬度。FIR濾波器51可進一步有效地在輸入VSYNC I_VSYNC的輸入週期定期地變化的情況下減少輸入週期的變化寬度。
    例如，如第8圖所示，FIR濾波器51包括：第一至第三正反器FF1至FF3，該等正反器依序地延遲並輸出輸入VSYNC I_VSYNC的輸入週期I_VSYNC[n](其中n為一正整數)；第一到第四乘法器61、62、63和64，該乘法器分別施加比重a_0、a_1、a_2和a_3至輸入VSYNC I_VSYNC之當前的輸入週期I_VSYNC[n]和從第一到第三正反器FF1到FF3輸出之先前的輸入週期I_VSYNC[n-1]、I_VSYNC[n-2]、I_VSYNC[n-3]；以及加法器65，其將該複數個先前的輸入週期加總，該等先前的輸入週期以於第一到第四乘法器61、62、63和64被施加比重，以輸出濾波輸入週期I_VSYNC_FIR。從加法器65輸出的輸入VSYNC I_VSYNCd的輸入濾波輸入週期I_VSYNC_FIR表示如下：I_VSYNC_FIR=a_0 x I_VSYNC[n]+a_1 x I_VSYNC[n-1]+a_2 x I_VSYNC[n-2]+a_3 xI_VSYNC[n-3]
    在上述中，分別施加到輸入VSYNC I_VSYNC之當前的輸入週期I_VSYNC[n]和複數個先前的輸入週期I_VSYNC[n-1]、I_VSYNC[n-2]和I_VSYNC[n-3]的比重a_0、a_1、a_2和a_3，可被預設為相同或可預設以增加或減少更接近於當前的輸入週期。在一個例子中，比重a_0、a_1、a_2和a_3可都被設為四分之一。在另外一個例子中，比重a_0和a_1可被設為八分之一，比重a_2可被設為四分之一，而比重a_3可被設為二分之一。
    內部VSYNC產生單元52比較來自FIR濾波器51的濾波輸入週期I_VSYNC_FIR與先前的輸出週期，並產生且輸出內部VSYNC O_VSYNC，該內部VSYNC O_VSYNC的週期根據比較結果來設置。這種方法的詳細描述由上述第4圖取代。根據本發明的第一實施例，類似於使用週期限制器54的情況，因為內部VSYNC產生單元52利用通過FIR濾波器減小變化寬度的輸入週期I_VSYNC_FIR，限制內部VSYNC O_VSYNC的輸出週期的變化寬度是可能的。
    PCLK產生單元56根據自內部VSYNC產生單元52提供的內部VSYNC O_VSYNC的輸出週期，產生並輸出內部時脈PCLK。
    使用自PCLK產生單元56提供的內部時脈PCLK，PWM產生單元58產生PWM信號，並輸出PWM信號給背光單元50，該PWM信號具有取決於從外部系統或時序控制器輸入的調光值的負載比。
    第9圖為說明根據本發明第三實施例之背光驅動器的內部配置的方塊圖。
    如第9圖所示，第三實施例的背光驅動器是第2圖所示之第一實施例的背光驅動器和第7圖所示之第二實施例的背光驅動器的結合，因此包括FIR濾波器51和週期限制器54，該FIR濾波器51和週期限制器54分別提供在內部VSYNC產生單元52的輸入端和輸出端。上述實施例重複的詳細描述被省略。
    FIR濾波器51藉由施加比重至輸入VSYNC I_VSYNC之當前的輸入週期和複數個相鄰的先前的輸入週期輸出濾波輸入週期I_VSYNC_FIR，以反映在當前的輸入週期內的結果，該濾波輸入週期I_VSYNC_FIR具有關於複數個輸入週期的平均值。
    內部VSYNC產生單元52比較來自FIR濾波器51的濾波輸入週期I_VSYNC_FIR與先前的輸出週期，並產生且輸出內部VSYNC O_VSYNC_A，該內部VSYNC O_VSYNC_A的輸出週期根據該比較結果來設置。
    週期限制器54自先前的輸出週期限制從內部VSYNC產生單元52所提供的內部VSYNC O_VSYNC_A的輸出週期在預定義的區間內，並輸出具有該限制輸出週期的內部VSYNC O_VSYNC_B。一種用於限制輸出週期的方法與第3圖的上述描述相同。
    PCLK產生單元56根據自週期限制器54提供的內部VSYNC O_VSYNC_B的輸出週期，產生並輸出內部時脈PCLK。
    使用自PCLK產生單元56提供的內部時脈PCLK，PWM信號產生單元58產生PWM信號，並輸出PWM信號給背光單元50，該PWM信號具有取決於從外部系統或時序控制器20輸入的調光值的負載比。
    在這種方法下，使用分別提供在內部VSYNC產生單元52的輸入端與輸出端的FIR濾波器51和週期限制器54，背光驅動器限制輸入VSYNC和內部VSYNC的輸入週期與輸出週期，從而當輸入VSYNC的週期週期性地變化時，阻止輸入VSYNC和輸出VSYNC的同步中斷。
    第10圖為說明在第9圖中所示之背光驅動器的頻率變快的情況下，輸入VSYNC和輸出VSYNC的同步和輸出週期的變化波形圖；第11圖為說明在第9圖中所示之背光驅動器的頻率變慢的情況下，輸入VSYNC和輸出VSYNC的同步和輸出週期的變化波形圖；以及第12圖為說明在第9圖中所示之背光驅動器的輸入VSYNC頻率重複變化的情況下，輸入VSYNC和輸出VSYNC的同步和輸出週期的變化波形圖。
    參考第10圖和第11圖，可察知類似於在除了FIR濾波器51外，週期限制器54限制內部VSYNC O_VSYNC_A的輸出週期的情況下，當輸入VSYNC變快或變慢時，作為使用FIR濾波器51和週期限制器54限制內部VSYNC O_VSYNC_A的輸入輸出週期的結果，獲得較小的週期的變化寬度和內部VSYNC O_VSYNC_A與輸入VSYNC的同步也是可能的，這可阻止由於週期的突然變化所引起的閃爍。在此，參考第8圖中的FIR濾波器51，比重a_0和a_1可被設為八分之一，比重a_2可被設為四分之一，而比重a_3可被設為二分之一。
    參考第12圖，可察知，當輸入VSYNC重複地變快或變慢時，即當頻率變化週期性地重複時，使用除了FIR濾波器51外的週期限制器54僅限制內部VSYNC O_VSYNC_A的輸出週期會造成輸入VSYNC和輸出VSYNC彼此不協調固定的週期Tc。另一方面，可察知當使用FIR濾波器51和週期限制器54限制內部VSYNC O_VSYNC_A的輸入輸出週期時，在當內部VSYNC O_VSYNC_B的週期重複變化時，內部VSYNC O_VSYNC_B跟隨輸入VSYNC而與輸入VSYNC同步化。
    從上述中是顯而易見的，在根據本發明之用於同步化輸入同步信號與輸出同步信號的方法及電路、利用該方法及電路之液晶顯示裝置的背光驅動器以及用於驅動該背光驅動器的方法的中，作為根據同步信號之輸入週期和先前的輸出週期之間的比較結果設置輸出週期以及限制輸入週期與輸出週期在預定義區間內的結果，即使輸入週期突然或重複地變化，阻止輸出週期的突然變化的同時實現輸入週期與輸出週期的同步、甚至在同步期間產生並輸出穩定的輸出同步信號是可能的。因此，藉由根據穩定輸出週期產生內部時脈和穩定地產生具有期望的負載比的PWM信號來阻止閃爍是可能的，以便於驅動背光單元。
    儘管本發明的實施例通過例子的方式僅描述了使用背光驅動器互相同步化輸入VSYNC和內部VSYNC的方法，上文描述之互相同步化輸入VSYNC和內部VSYNC的方法可應用到使用VSYNC信號之其他裝置中，也可應用到除了VSYNC信號以外之其他同步化輸入同步信號與輸出同步信號的方法中。
    在本發明中沒有脫離本發明的精神或範圍下，所做的修改和變化對於熟悉本領域的技術人員來說是顯而易見的。因此，凡有在相同的發明精神下所作有關本發明的任何修飾或變更，皆仍應包括在本發明意圖保護的範疇。
    本申請案主張於2011年12月1號提交的韓國專利申請第10-2011-0127998號的優先權。該專利申請在此全部併入作為參考。
    20‧‧‧時序控制器
    22‧‧‧面板驅動單元
    24‧‧‧資料驅動器
    26‧‧‧閘極驅動器
    28‧‧‧液晶面板
    30‧‧‧背光驅動器
    50‧‧‧背光單元
    51‧‧‧有限脈衝響應濾波器
    52‧‧‧內部垂直同步信號產生單元
    54‧‧‧週期限制器
    56‧‧‧內部時脈產生單元
    58‧‧‧脈寬調變信號產生單元
    61‧‧‧第一乘法器
    62‧‧‧第二乘法器
    63‧‧‧第三乘法器
    64‧‧‧第四乘法器
    65‧‧‧加法器
    FF1‧‧‧第一正反器
    FF2‧‧‧第二正反器
    FF3‧‧‧第三正反器
    S2~S20‧‧‧步驟
    S100、S200、S202、S204‧‧‧步驟
    所附圖式，其中提供關於本發明的進一步理解並且結合與構成本說明書的一部份。所附圖式說明本發明的實施例並且與說明書一同提供對於本發明之原則的解釋。圖式中：第1圖為說明根據本發明一實施例之液晶顯示器裝置的方塊圖；第2圖為說明根據本發明第一實施例之背光驅動器的內部配置的方塊圖；第3圖為說明用於同步化在第2圖中所示之背光驅動器的輸入同步信號與輸出同步信號的方法的流程圖；第4圖為詳細說明在第3圖中所示之內部垂直同步信號的產生操作的流程圖；第5圖為說明在第2圖中所示之背光驅動器頻率變快的情況下，輸入同步信號與輸出同步信號的同步和輸出週期變化的波形圖；第6圖為說明在第2圖中所示之背光驅動器頻率變慢的情況下，輸入同步信號與輸出同步信號的同步和輸出週期變化的波形圖；第7圖為說明根據本發明第二實施例之背光驅動器的內部配置的方塊圖；第8圖為說明在第7圖中所示之FIR濾波器的較佳配置的方塊圖；第9圖為說明根據本發明第三實施例之背光驅動器的內部配置的方塊圖；第10圖為說明在第9圖中所示之背光驅動器頻率變快的情況下，輸入同步信號與輸出同步信號的同步和輸出週期變化的波形圖；第11圖為說明在第9圖中所示之背光驅動器頻率變慢的情況下，輸入同步信號與輸出同步信號的同步和輸出週期變化的波形圖；以及第12圖為說明在第9圖中所示之背光驅動器頻率重複變化的情況下，輸入同步信號與輸出同步信號的同步和輸出週期變化的波形圖。
    30‧‧‧背光驅動器
    52‧‧‧內部垂直同步信號產生單元
    54‧‧‧週期限制器
    56‧‧‧內部時脈產生單元
    58‧‧‧脈寬調變信號產生單元
    权利要求:
    Claims (26)
    [1] 一種用於同步化輸入同步信號與輸出同步信號的方法，該方法包括：產生一輸出同步信號，該輸出同步信號的一輸出週期係根據一輸入同步信號的一輸入週期與該輸出同步信號的一先前的輸出週期的比較結果來設置；以及將該輸出同步信號的該輸出週期限制在該先前的輸出週期的一預定義的限制範圍內。
    [2] 依據申請專利範圍第1項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中限制該輸出同步信號的該輸出週期包括：將該輸出週期與該限制範圍作比較；如果該輸出週期在該限制範圍內，保持並輸出該輸出週期；以及如果該輸出週期超出了該限制範圍，將該輸出週期設置為該限制範圍內的一最小值或一最大值以輸出該設置的輸出週期。
    [3] 依據申請專利範圍第2項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中該輸出週期的該限制範圍預設為“該先前的輸出週期+/-臨界值”，該臨界值小於該先前的輸出週期。
    [4] 依據申請專利範圍第3項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中：如果該輸出週期小於該限制範圍，該輸出週期設置為該限制範圍的該最小值並且輸出該最小值的該輸出週期；以及如果該輸出週期大於該限制範圍，該輸出週期設置為該限制範圍的該最大值並且輸出該最大值的該輸出週期。
    [5] 依據申請專利範圍第1項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中產生該輸出同步信號包括：檢測該輸入同步信號的一第N輸入週期，其中N為一正整數；判斷該檢測的第N輸入週期是否等於該輸出同步信號的一先前的第N-1輸入週期；如果該檢測的第N輸入週期不等於該輸出同步信號的一先前的第N-1輸入週期，檢測該第N-1輸出週期的一結束時間和該第N輸入週期的一結束時間之間的差異；在該檢測的差異和該第N輸入週期之間執行計算，並將該計算值設置至一第N輸出週期；以及產生並輸出一具有該設置的第N輸出週期的輸出同步信號。
    [6] 依據申請專利範圍第5項之用於同步化輸入同步信號與輸出同步信號的方法，在檢測該第N輸入週期之後，進一步包括：判斷該檢測的第N輸入週期是否在一預設的參考範圍內；以及如果該第N輸入週期超出了該參考範圍，產生並輸出一具有該第N-1輸出週期的輸出同步信號，其中如果該第N輸入週期在該參考範圍內，該方法繼續判斷該第N輸入週期是否等於該第N-1輸出週期。
    [7] 依據申請專利範圍第5項所述之用於同步化輸入同步信號與輸出同步信號的方法，進一步包括如果該第N輸入週期等於該第N-1輸出週期，將該第N輸入週期設置為該第N輸出週期並輸出該第N輸出週期，其中設置該計算值至該第N輸出週期包括：如果該第N輸入週期變得比該第N-1輸出週期大，設置藉由將該檢測的差異加至該第N輸入週期而獲得的一值至該第N輸出週期；以及如果該第N輸入週期變得比該第N-1輸出週期小，設置藉由從該第N輸入週期減去該檢測的差異而獲得的一值至該第N輸出週期。
    [8] 依據申請專利範圍第5項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中該等同步信號的該第N輸入週期和該第N輸出週期具有至少一個週期的時間差。
    [9] 依據申請專利範圍第5項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中該輸入同步信號的該輸入週期為一濾波輸入週期，該濾波輸入週期藉由對複數個相鄰的輸入週期低通濾波來獲得。
    [10] 依據申請專利範圍第9項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中該濾波輸入週期藉由分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果來獲得。
    [11] 一種用於同步化輸入同步信號與輸出同步信號的方法，該方法包括：低通濾波一輸入同步信號的複數個相鄰的輸入週期以輸出一濾波輸入週期；以及產生一輸出同步信號，該輸出同步信號的一輸出週期係根據該濾波輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置。
    [12] 依據申請專利範圍第11項所述之用於同步化輸入同步信號與輸出同步信號的方法，其中該濾波輸入週期藉由分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果來獲得。
    [13] 一種用於同步化輸入同步信號與輸出同步信號的電路，該電路包括：一內部同步信號產生單元，其產生一輸出同步信號，該輸出同步信號的一輸出週期係根據一輸入同步信號的一輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置；以及一週期限制器，其將該輸出同步信號的該輸出週期限制在該先前的輸出週期的一預定義的限制範圍內。
    [14] 依據申請專利範圍第13項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該週期限制器：將該輸出週期與該限制範圍作比較；如果該輸出週期在該限制範圍內，保持並輸出該輸出週期；以及如果該輸出週期超出了該限制範圍，將該輸出週期設置為該限制範圍內的一最小值或一最大值以輸出該設置的輸出週期。
    [15] 依據申請專利範圍第14項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該輸出週期的該限制範圍係預設為“該先前的輸出週期+/-臨界值”，該臨界值小於該先前的輸出週期。
    [16] 依據申請專利範圍第15項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中：如果該輸出週期小於該限制範圍，該輸出週期設置為該限制範圍的該最小值並且輸出該最小值的該輸出週期；以及如果該輸出週期大於該限制範圍，該輸出週期設置為該限制範圍的該最大值並且輸出該最大值的該輸出週期。
    [17] 依據申請專利範圍第13項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該內部同步信號產生單元：檢測該輸入同步信號的一第N輸入週期，其中N為一正整數；判斷該檢測的第N輸入週期是否等於該輸出同步信號的一先前的第N-1輸入週期；如果該檢測的第N輸入週期不等於該輸出同步信號的該先前的第N-1輸入週期，檢測該第N-1輸出週期的結束時間和該第N輸入週期的結束時間之間的差異；在該檢測的差異和該第N輸入週期之間執行計算，並將該計算值設置至一第N輸出週期；以及產生並輸出一具有該設置的第N輸出週期的輸出同步信號。
    [18] 依據申請專利範圍第17項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中：該內部同步信號產生單元在檢測該第N輸入週期之後，判斷該檢測的第N輸入週期是否在一預設的參考範圍內；以及如果該第N輸入週期超出了該參考範圍，該內部同步信號產生單元產生並輸出具有該第N-1輸出週期的該輸出同步信號，其中如果該第N輸入週期在該參考範圍內，該內部同步信號產生單元該方法繼續判斷該第N輸入週期是否等於該第N-1輸出週期。
    [19] 依據申請專利範圍第18項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中：如果該第N輸入週期等於該第N-1輸出週期，該內部同步信號產生單元將該第N輸入週期設置為該第N輸出週期以輸出該第N輸出週期，如果該第N輸入週期變得比該第N-1輸出週期大，該內部同步信號產生單元設置藉由將該檢測的差異加至該第N輸入週期而獲得的一值至該第N輸出週期；以及如果該第N輸入週期變得比該第N-1輸出週期小，該內部同步信號產生單元設置藉由從該第N輸入週期減去該檢測的差異而獲得的一值至該第N輸出週期。
    [20] 依據申請專利範圍第17項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該等同步信號的該第N輸入週期和該第N輸出週期具有至少一個週期的時間差。
    [21] 依據申請專利範圍第17項所述之用於同步化輸入同步信號與輸出同步信號的電路，進一步包括一低通濾波器，其提供該輸入週期至該內部同步信號產生單元，該輸入週期係藉由對該輸入同步信號的複數個相鄰的輸入週期低通濾波而獲得的一濾波輸入週期。
    [22] 依據申請專利範圍第21項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該低通濾波器是一有限脈衝響應濾波器，該有限脈衝響應濾波器分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果。
    [23] 一種用於同步化輸入同步信號與輸出同步信號的電路，該電路包括：一低通濾波器，其執行一輸入同步信號的複數個相鄰的輸入週期的低通濾波以輸出一濾波輸入週期；以及一內部同步信號產生單元，其產生一輸出同步信號，該輸出同步信號的一輸出週期係根據該濾波輸入週期與該輸出同步信號之一先前的輸出週期的比較結果來設置
    [24] 依據申請專利範圍第23項所述之用於同步化輸入同步信號與輸出同步信號的電路，其中該低通濾波器是一有限脈衝響應濾波器，該有限脈衝響應濾波器分別施加比重至該輸入同步信號之一當前的輸入週期和相鄰於該當前的輸入週期的複數個先前的輸入週期並統計其結果。
    [25] 一種用於驅動液晶顯示裝置的背光驅動器的方法，該方法包括：產生並輸出一輸出垂直同步信號，該輸出垂直同步信號係使用依據申請專利範圍第1項至12項任一項所述之用於同步化輸入同步信號與輸出同步信號的方法根據一輸入垂直同步信號的一輸入週期的變化來同步化；根據該輸出垂直同步信號的一輸出週期，產生內部時脈；以及使用該等內部時脈產生一具有一預定的負載比的脈寬調變信號以驅動一背光單元。
    [26] 一種液晶顯示裝置的背光驅動器，該背光驅動器包括：一同步電路，其產生並輸出一輸出垂直同步信號，該輸出垂直同步信號係使用依據申請專利範圍第13項至24項任一項所述之用於同步化輸入同步信號與輸出同步信號的電路根據一輸入垂直同步信號的一輸入週期的變化來同步化；一時脈產生單元，其根據自該同步電路之該輸出垂直同步信號的一輸出週期，產生內部時脈；以及一脈寬調變信號產生單元，其使用該等內部時脈產生一具有一預定的負載比的脈寬調變信號以驅動一背光單元。
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